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synced 2024-11-14 12:42:52 +00:00
commit
993afd3bf0
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@ -6091,22 +6091,28 @@ L_stm_s_takeabort:
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//ichfly
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//SSAT16
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{
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u8 tar = BITS(12, 15);
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u8 src = BITS(0, 3);
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u8 val = BITS(16, 19) + 1;
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s16 a1 = (state->Reg[src]);
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s16 a2 = (state->Reg[src] >> 0x10);
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||||
s16 min = (s16)(0x8000 >> (16 - val));
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||||
s16 max = 0x7FFF >> (16 - val);
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if (min > a1) a1 = min;
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if (max < a1) a1 = max;
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||||
if (min > a2) a2 = min;
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||||
if (max < a2) a2 = max;
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||||
u32 temp2 = ((u32)(a2)) << 0x10;
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||||
state->Reg[tar] = (a1 & 0xFFFF) | (temp2);
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||||
const u8 rd_idx = BITS(12, 15);
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||||
const u8 rn_idx = BITS(0, 3);
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||||
const u8 num_bits = BITS(16, 19) + 1;
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||||
const s16 min = -(0x8000 >> (16 - num_bits));
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||||
const s16 max = (0x7FFF >> (16 - num_bits));
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||||
s16 rn_lo = (state->Reg[rn_idx]);
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||||
s16 rn_hi = (state->Reg[rn_idx] >> 16);
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if (rn_lo > max)
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rn_lo = max;
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else if (rn_lo < min)
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rn_lo = min;
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if (rn_hi > max)
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rn_hi = max;
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||||
else if (rn_hi < min)
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||||
rn_hi = min;
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||||
state->Reg[rd_idx] = (rn_lo & 0xFFFF) | ((rn_hi & 0xFFFF) << 16);
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return 1;
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}
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return 1;
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default:
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break;
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}
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