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maxwell_3d: Add depth bounds registers
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parent
e976d0e924
commit
5770418fb3
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@ -707,13 +707,15 @@ public:
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u32 color_mask_common;
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INSERT_UNION_PADDING_WORDS(0x6);
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||||
u32 rt_separate_frag_data;
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||||
INSERT_UNION_PADDING_WORDS(0x2);
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||||
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||||
f32 depth_bounds[2];
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||||
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||||
INSERT_UNION_PADDING_WORDS(0xA);
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||||
INSERT_UNION_PADDING_WORDS(0x2);
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||||
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||||
u32 rt_separate_frag_data;
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||||
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||||
INSERT_UNION_PADDING_WORDS(0xC);
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||||
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struct {
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||||
u32 address_high;
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@ -1030,7 +1032,12 @@ public:
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BitField<4, 1, u32> depth_clamp_far;
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||||
} view_volume_clip_control;
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||||
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||||
INSERT_UNION_PADDING_WORDS(0x21);
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||||
INSERT_UNION_PADDING_WORDS(0x1F);
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||||
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||||
u32 depth_bounds_enable;
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||||
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||||
INSERT_UNION_PADDING_WORDS(1);
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||||
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||||
struct {
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||||
u32 enable;
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||||
LogicOperation operation;
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||||
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@ -1439,7 +1446,7 @@ ASSERT_REG_POSITION(stencil_back_func_mask, 0x3D6);
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|||
ASSERT_REG_POSITION(stencil_back_mask, 0x3D7);
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||||
ASSERT_REG_POSITION(color_mask_common, 0x3E4);
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||||
ASSERT_REG_POSITION(rt_separate_frag_data, 0x3EB);
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||||
ASSERT_REG_POSITION(depth_bounds, 0x3EC);
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||||
ASSERT_REG_POSITION(depth_bounds, 0x3E7);
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||||
ASSERT_REG_POSITION(zeta, 0x3F8);
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||||
ASSERT_REG_POSITION(clear_flags, 0x43E);
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||||
ASSERT_REG_POSITION(vertex_attrib_format, 0x458);
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||||
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@ -1495,6 +1502,7 @@ ASSERT_REG_POSITION(cull, 0x646);
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ASSERT_REG_POSITION(pixel_center_integer, 0x649);
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||||
ASSERT_REG_POSITION(viewport_transform_enabled, 0x64B);
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||||
ASSERT_REG_POSITION(view_volume_clip_control, 0x64F);
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||||
ASSERT_REG_POSITION(depth_bounds_enable, 0x66F);
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||||
ASSERT_REG_POSITION(logic_op, 0x671);
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||||
ASSERT_REG_POSITION(clear_buffers, 0x674);
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||||
ASSERT_REG_POSITION(color_mask, 0x680);
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